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09325219电子可调定时器(可编辑)doc下载

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  • 2019-05-16
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简介 我是一名品学兼优的学生,热爱祖国,勤奋学习,团结同学,活泼开朗。我时时刻刻用“四个好少年”的标准来严格要求自己。 平时,我非常关心祖国的一点一滴进步,每天早晨我都会边吃早餐边听新闻,在第一时间

我是一名品学兼优的学生,热爱祖国,勤奋学习,团结同学,活泼开朗。我时时刻刻用“四个好少年”的标准来严格要求自己。  平时,我非常关心祖国的一点一滴进步,每天早晨我都会边吃早餐边听新闻,在第一时间了解我们祖国的发展动态。“512”大地震,我和同学含着眼泪为四川的同胞捐款。

愿君多采撷,此物最相思。可是在我这里,一切都本末倒置,物换星移了。

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电子可调定时器课程设计、设计要求、设计思路、电子可调定时器的基本框架电子可调定时器的电路基本应包括秒指示电路、时间显示电路、按键电路、供电电源以及闹铃指示电路等几部分。 电子闹钟的系统框架如图示图时钟系统电路原理框图、电子可调定时器的设计原理其电路设计具体可包括:闹铃指示电路、系统时钟电路、时间显示电路、系统复位电路等的设计。 闹铃指示电路的设计本系统采用声音指示其电路如图所示。 其关键元件是蜂鸣器。 蜂鸣器有无源和有源两种有源的只需外加适当直流电源电压即可元件内部已封装了音频振荡电路在得电状态下即起振发声。

给予本电路的特点及实现功能的要求我们选用有源的蜂鸣器。 系统时钟电路设计振荡电路用于产生单片机工作所需要的时钟信号。

单片机内部有一个高增益反相放大器其输入端为芯片引脚XTAL输出端为引脚XTAL。 在芯片的外部有XTAL和XTAL之间跨接的晶体振荡器和微调电容共同构成了一个稳定的自激振荡器。

图中的C、C电容起着系统时钟频率微调和稳定的作用因此应正确选择参数(±pF)并保证其对称性。 图 系统时钟电路显示电路设计本设计采用显示译码器作为译码电路。

在数字系统和装置中显示器和译码器配合使用或者直接利用译码器驱动显示器这类译码器叫做显示译码器。

本设计采用LS译码电路。 图LS引脚图中规模集成电路LS是一种常用的七段显示译码器该电路的输出为低电平有效即输出为时对应字段点亮输出为时对应字段熄灭。 该译码器能够驱动七段显示器显示~共个数字的字形。 输入A、A、A和A接收位二进制码输出Qa、Qb、Qc、Qd、Qe、Qf和Qg分别驱动七段显示器的a、b、c、d、e、f和g段。 LS是输出低电平有效的七段字形译码器它在这里与数码管配合使用。 在数字钟电路中译码器的输入信号就是计数器的输出信号它的输出端接至数码管。

计数器输出的四位BCD码经译码后变成某个十进制数字对应的控制电平去驱动数码管各段发光从而把该数字显示出来。 BCD码译码器LS真值表见表。

由表可看出LS的输出为一组七位二进制代码有效信号为低电平。

而共阳极数码管要求输入为低电平正好与LS的输出电平极性相适配。 部分引脚功能LT:试灯输入是为了检查数码管各段是否能正常发光而设置的。

当LT=时无论输入AAAA为何种状态译码器输出均为低电平若驱动的数码管正常是显示。 BI:灭灯输入是为控制多位数码显示的灭灯所设置的。 BI=时。

不论LT和输入AAAA为何种状态译码器输出均为高电平使共阳极段数码管熄灭。

RBI:灭零输入它是为使不希望显示的熄灭而设定的。 当对每一位A=A=A=A=时本应显示但是在RBI=作用下使译码器输出全。

其结果和加入灭灯信号的结果一样将熄灭。

RBO:灭零输出它和灭灯输入BI共用一端两者配合使用可以实现多位数码显示的灭零控制。 表LS真值表字型输入输出NAAAAabcdefg最终的显示部分电路图如图所示图时钟电路的显示电路系统复位电路的设计本设计采用的是RC上电复位电路。 RC上电复位电路的实质是一阶充放电电路系统上电时该电路提供有效的复位信号RST(高电平)直至系统电源稳定后撤销复位信号(低电平)。 图 RC复位电路电源设计图 闹钟的电源系统原理图ATC通常有v和v两种型号对应的时钟频率分别为MHz和MHz。

考虑到交直流两用的要求和三端稳压电路选用的方便选择工作电压为V。 ST公司的三端稳压芯片最接近标称值(最大输出电流为A)。

在设计中必须保证的输入电压Vi和输出电压Vo满足Vi-Vo≥V否则失去稳压能力从功耗角度此压差太大则增加本身功率消耗。 因此选为V。 交流V电压经TR降压后经BR整流、C和C滤波及稳压后输出。

当交流电源失电或失效时则自动启用电池组作为备用电源。

电压为V的直流电源通过二极管作用。

、系统硬件电路设计本设计主要由主模块、基本显示模块、时间设置模块、系统走时模块以及闹铃判断模块等组成。 (源程序见附录)主模块设计主模块是系统软件的主框架。 它的合理与否关系到程序最终的功能的多少和性能的好坏。 程序中对于程序何时跳转、程序何时调用都要慎重安排。 最终确定以下的顺序:、图主流程图单片机数据缓存单元分配如下:走时时间存储单元:R、R、R定时时间存储单元:R、R分别存储时钟时间分位、时位闹铃时间存储单元:H、H分别存储第一次闹钟时间分位、时位H、H分别存储第二次闹钟时间分位、时位。 基本显示模块ATC中P为输出口低四位PP为要显示的数据的二进制码高四位PP为片选口用来选择具体令哪一个数码管亮。

例如想要显示时间点分。

先显示分位经BCD码调整后变为存入累加器A中累加器A先压栈目的为保护原累加器A中内容累加器A与相与变为此操作意为保护低位即要显示的数据。

此时与相加为即最终P口输出的数据位高四位控制数码管的显示P、P、P、P分别控制第四个、第三个、第二个、第一个数码管的亮灭此时P为高电平所以第四个数码管亮其余灭。

低四位送入LSLS输入为译码后输出信号为数码管为共阳极相接所以最终为第四个数码管显示为即分个位为。

释放累加器A此时交换累加器A中高半字节与低半字节的内容最终内容变为再同相与然后同相加最终结果为。

经片选、LS译码后最终第三个数码管显示为即分十位为。 时个位与时十位的显示原理与分个位显示原理相似唯一不同之处是时个位显示中与累加器A相加的为时十位显示中与累加器A相加的为即第一个数码管的片选信号为第二个数码管的片选信号为。 每一个数码管显示一个数调用延时四个数码管循环点亮由于调用延时时间为ms利用人的视觉暂留生理特性所以最终看到的为表示点分。 时间设定模块初始状态为用累加器存储总的按键次数累加器内容给R,从ATCP口输出高四位进行片选低四位送入ls经译码后输出显示其间有一个上下线的判断。 具体如下:小时的设置:每按一次时‘’键R内容自动加把R内容给A。 A进行BCD调整判断P的状态若P等于则系统为小时制式此时比较A中内容是否满满后A清零最终输出显示表示时十位、时个位为。

否则直接输出显示。 流程图如下:分的设置:刷新显示每按一次分‘’键R内容自动加把R内容给A。 A进行BCD调整此时比较A中内容是否满满后A清零然后输出显示表示分十位、分个位为否则直接输出显示。 流程图如下所示:图分钟设置流程图系统走时模块更新显示调用基本循环单元基本循环单元计时时间为s满sP取反进行秒指示并进行闹铃判断。

满秒分加并进行闹铃判断满分时加分清零并进行闹铃判断BCD调整并输出显示。

小时制式时时满则时赋新值为小时制时时满则赋新值为并输出显示。

流程图如下:闹铃判断模块设置闹铃时间后正常走时时间每变化一秒都要进行闹铃判断。

当前小时与闹铃小时相同时进行分钟判断不同时正常走时。 当前分钟与闹铃分钟相同时则启动闹铃不同时正常走时。 闹铃响时按叫停键后闹铃停止存储闹铃时间的单元自动清零时钟正常走时。

流程图如下所示:定时器初始化设定系统工作在定时器计数器且工作方式为设置系统外部中断定时器计数器赋初值定时时间为ms。 、设计感想、参考文献徐雪松电子定时器科学出版社。

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